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Date 2021-01-27
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摘要

针对图像处理的实时性要求,设计了一种基于FPGA的图像压缩编解码系统。该系统包括实时图像采集、JPEG压缩以及UART传输等功能。采用Altera公司的DE系列开发板,应用Verilog HDL硬件描述语言对D5M摄像头进行配置,完成图像采集。在图像压缩模块,重点对2D-DCT变换进行改进。在基于Chen算法的基础上采用二分频信号控制器,减少了加法器的调用,实现其快速运算,进而完成图像压缩功能。在URAT传输模块,主要完成串行通信与并行通信间的转换。测试表明,图像的压缩比达到26.3:1,其均值信噪比大于40 dB,压缩后的视觉效果良好,符合设计要求。

摘要:

现场可编程逻辑门阵列(FPGA)在航电系统领域广泛应用,但是采用JTAG方式更新FPGA程序,效率低下,易受设备环境限制而缺乏灵活性,已经难以满足工程应用的需求。提出了一种实现FPGA程序远程更新的方案,该方案采用RapidIO总线,以软件异构的方式,构建在线更新实时通信链路。通过以太网下发镜像升级文件,经SRIO交换网络传送至FPGA节点,写入FLASH配置空间,实现FPGA程序的远程更新。经过测试,验证了设计的正确性和可行性,并有效地提高了FPGA程序更新的速度。

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基于RapidIO的FPGA远程更新系统设计与实现

Date 2019-03-14
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基于FPGA的SATA硬盘加解密控制器设计

Date 2019-03-12
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基于双FPGA的MVB通用接口研制

Date 2019-03-13
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基于CPLD的UART设计

Date 2019-03-12
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